El almacenador intermediario Lo del reloj del reloj del ICS del contador de tiempo del reloj de CDCLVP1102RGTR está inquieto 1:2 Uni-a los frb de LVPECL
timer ic chip
,time delay ic chip
El almacenador intermediario Lo del reloj del reloj del ICS del contador de tiempo del reloj de CDCLVP1102RGTR está inquieto 1:2 Uni-a los frb de LVPECL
Características 1
- Almacenador intermediario diferenciado del 1:2
• Sola entrada de reloj
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Las entradas universales pueden aceptar LVPECL, LVDS, LVCMOS/LVTTL
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Dos salidas de LVPECL
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Frecuencia de reloj máxima: 2 gigahertz
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Consumo actual máximo de la base: 33 mA
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Inquietud aditiva muy baja: <100 fs="">
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2.375-V a la fuente de alimentación del dispositivo 3.6-V
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Retraso de propagación máximo: 450 picosegundos
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Posición oblicua de la salida máxima: 10 picosegundos
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Voltaje de la referencia de LVPECL, VAC_REF, disponible para las entradas Capacitivo-juntadas
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Gama de temperaturas industrial: – 40°C a 85°C
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Temperatura del PWB de las ayudas 105°C (medida en el cojín termal)
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Disponible en 3 paquete del milímetro QFN-16 (RGT) del × 3 del milímetro
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La protección del ESD excede 2 kilovoltios (HBM)
2 usos
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Comunicaciones inalámbricas
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Telecomunicaciones/establecimiento de una red
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Proyección de imagen médica
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Equipo de la prueba y de medida
INP INN
VAC_REF
Descripción 3
El CDCLVP1102 es un almacenador intermediario aditivo altamente versátil, bajo de la inquietud que puede generar dos copias de las salidas de reloj de LVPECL a partir de un LVPECL, LVDS, o LVCMOS entró para una variedad de usos de comunicación. Tiene una frecuencia de reloj máxima hasta 2 gigahertz. El funcionamiento aditivo total de la inquietud es menos de 0,1 picosegundos, el RMS a partir de 10 kilociclos a 20 megaciclos, y la posición oblicua total de la salida es tan bajos como 10 picosegundos, tomando el dispositivo una decisión perfecta para el uso en usos exigentes.
El almacenador intermediario del reloj CDCLVP1102 distribuye una sola entrada de reloj (ADENTRO) a dos pares de las salidas de reloj diferenciadas de LVPECL (OUT0, OUT1) con la posición oblicua mínima para la distribución de reloj. Las entradas pueden ser LVPECL, LVDS, o LVCMOS/LVTTL.
El CDCLVP1102 se diseña específicamente para conducir líneas de transmisión 50-Ω. Al conducir las entradas en modo de terminación única, el voltaje de polarización de LVPECL (VAC_REF) se debe aplicar al perno negativo inusitado de la entrada. Sin embargo, para el funcionamiento de alta velocidad hasta 2 gigahertz, modo diferenciado se recomiendan fuertemente.
El CDCLVP1102 se caracteriza para la operación – de 40°C a 85°C y está disponible en un QFN-16, 3 milímetros de × paquete de 3 milímetros.
Información del dispositivo
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NÚMERO DE PARTE |
PAQUETE |
TAMAÑO DE CUERPO (NOM) |
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CDCLVP1102 |
QFN (16) |
3,00 milímetros de × 3,00 milímetros |
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