D-tipo programable balanceo del ICS Flip Flops Dual Pos-Edge-Trgrd de la lógica de SN74LV74ADR
programmable logic array ic
,programmable computer chip
D-tipo programable balanceo del ICS Flip Flops Dual Pos-Edge-Trgrd de la lógica de SN74LV74ADR
Características 1
- 2-V a la operación de 5.5-V VCC
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Maximumtpdof8.5nsat5V
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VOLP típico (despedida de tierra de la salida) <0>
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VOHV típico (aterrizaje corto) de la salida VOH >2.3VatVCC =3.3V, TA =25°C
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Operación del voltaje del Mezclado-modo de la ayuda en todos los puertos
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Operación del modo del Parcial-poder-Abajo de las ayudas de Ioff
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El funcionamiento del cierre-para arriba excede 250 mA por JESD 17
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La protección del ESD excede JESD 22
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– modelo del Humano-cuerpo 2000-V (A114-A)
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– modelo del Cargar-dispositivo 500-V (C101)
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2 usos
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Regulador programable de la lógica (PLC)
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DCS y PAC: Módulo entrado análogo
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Receptor AV
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Fuente de alimentación del servidor
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STB, DVR, y fluir medios (retírese)
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Placa madre del servidor
Descripción 3
Este el D-tipo positivo-borde-accionado dual balanceos se diseña para 2-V a la operación de 5.5-V VCC.
Información del dispositivo
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NÚMERO DE PARTE |
PAQUETE |
TAMAÑO DE CUERPO (NOM) |
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SN74LV74A |
VQFN (14) |
3,50 milímetros de × 3,50 milímetros |
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SOIC (14) |
8,65 milímetros de × 3,91 milímetros |
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COMPENSACIÓN (14) |
10,30 milímetros de × 5,30 milímetros |
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SSOP (14) |
6,20 milímetros de × 5,30 milímetros |
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TSSOP (14) |
5,00 milímetros de × 4,40 milímetros |
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