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1 Mbit serial IC bus EEPROM circuito integrado IC Chip M24M01-RMN6TP

fabricante:
Fabricante
Descripción:
Memoria EEPROM IC 1 Mbit I²C 1 MHz 500 ns 8-SOIC
Categoría:
Chip CI de memoria Flash
Precio:
Negotiation
Forma de pago:
T/T, Western Union, Paypal
Especificaciones
Error preestablecido del voltaje de salida:
sobrecarga menos de ±5%,
n especificó en una corriente de salida:
100mA
condensador de la salida:
0.1µF
Línea máxima regulación:
menos de 0,07% VOUT/V
Regulación de la carga máxima:
menos de 0,01% VOUT/mA
Punto culminante:

electronics ic chip

,

integrated circuit ic

Introducción

 

Descripción

El M24M01-R es un dispositivo de memoria programable borrable eléctricamente (EEPROM) compatible con I2C organizado como 128 Kb × 8 bits.El bus I2C es una interfaz serial de dos hilos, que comprende una línea de datos bidireccional y una línea de reloj.Los dispositivos llevan incorporado un código identificador de tipo de dispositivo de 4 bits (1010) de acuerdo con la definición de bus I2C.El M24M01-R se comporta como esclavo en el protocolo I2C, con todas las operaciones de memoria sincronizadas por el reloj serie.Las operaciones de lectura y escritura son generadas por el bus maestro e iniciadas por una condición de inicio, seguida por el código de selección del dispositivo, los bytes de dirección y los bytes de datos.Las transferencias de datos finalizan con una condición de parada después de un Ack para escritura y después de un NoAck para lectura.Al escribir datos en la memoria, el dispositivo inserta un bit de reconocimiento durante el noveno bit, siguiendo la transmisión de 8 bits del bus maestro.Cuando el maestro del bus lee los datos, el maestro del bus acusa recibo del byte de datos de la misma manera.Para cumplir con los requisitos ambientales, ST ofrece el M24M01-R en paquetes ECOPACK®.Los paquetes ECOPACK® no contienen plomo y cumplen con RoHS.ECOPACK es una marca registrada de ST.Las especificaciones de ECOPACK están disponibles en: www.st.com.

 

 

Figura 4.

Valor máximo de Rbus versus capacitancia parásita de bus (Cbus) para un I2C

bus a máxima frecuencia fC = 400 kHz

 

Operación del dispositivo

El dispositivo es compatible con el protocolo I2C.Esto se resume en la Figura 6. Cualquier dispositivo que envíe datos al bus se define como un transmisor y cualquier dispositivo que lea los datos como un receptor.El dispositivo que controla la transferencia de datos se conoce como bus maestro y el otro como dispositivo esclavo.Una transferencia de datos solo puede ser iniciada por el bus maestro, que también proporcionará el reloj en serie para la sincronización.El dispositivo M24M01-R es siempre un esclavo en todas las comunicaciones.

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