El desarrollo de IC de la conversión de datos de DAC38J84EVM equipa la MOD de las herramientas de desarrollo de DAC38J84 EVAL MO Data Conversion IC DAC38J84 EVAL
semiconductor integrated circuit
,pic microcontroller circuit
El desarrollo de IC de la conversión de datos de DAC38J84EVM equipa la MOD de las herramientas de desarrollo de DAC38J84 EVAL MO Data Conversion IC DAC38J84 EVAL
Descripción funcional
El DAC3XJ8XEVM se piensa para la evaluación de la familia de alta velocidad, interfaz DACs de DAC3XJ8X de JESD204B. La señal de entrada digital al DAC se proporciona del conector de FMC (J16) en hasta ocho carriles de 12.5-Gbps SerDes usando el estándar de interfaz de JESD204B. El conector de FMC también se utiliza para la señal de SINCRONIZACIÓN requerida establecer el vínculo de JESD204B y reloj del dispositivo y señal de SYSREF para FPGA.
La salida analógica del DAC3XJ8X se puede supervisar en los conectores instalados de SMA etiquetó IOUTA con IOUTD para los canales A a D, respectivamente. Las salidas analógicas son transformador juntado y no pasan señales de baja fricción debajo de aproximadamente 10 megaciclos. El transformador convierte la salida diferenciada de DAC a una salida de terminación única para el uso con el equipo de laboratorio común a través de conexiones de cable atadas con alambre de SMA.
Los relojes para el DAC y FPGA se distribuyen usando el limpiador ultra de poco ruido de la inquietud del reloj LMK04828 para los usos de JESD204B. El LMK04828 se puede poner en una variedad de configuraciones incluyendo modo de la distribución de reloj y modo de la limpieza de la inquietud del dual-lazo. En modo de la distribución de reloj, la tarifa de salida deseada de DAC se proporciona al conector de CLKIN y el LMK04828 divide y distribuye los relojes del dispositivo y las señales de SYSREF. En modo del dual-lazo, el conector de CLKIN se puede utilizar para proporcionar una referencia al LMK04828, pero los relojes se generan a bordo usando el LMK04828 PLL y los 122,88 megaciclos a bordo VCXO.
Conector o Jumper Label | Diseñador de referencia | Propósito |
IOUTAP | J2 | Salida juntada transformador de DAC Channel A |
IOUTBN | J8 | Salida juntada transformador de DAC Channel B |
IOUTCP | J9 | Salida juntada transformador de DAC Channel C |
IOUTDN | J11 | Salida juntada transformador de DAC Channel D |
SPI_SELECTOR | JP3 | Fuente selecta de la señal de SPI. Ponga en cortocircuito 1-2 para el conector de FMC, 2-3 para el USB. |
1.8V_SEL | JP5 | Fuente selecta de la fuente 1.8-V para CPLD. Ponga en cortocircuito 1-2 para la fuente del tablero, 2-3 para la alimentación por USB. |
3.3V_SEL | JP6 | Fuente selecta de la fuente 3.3-V para CPLD. Ponga en cortocircuito 1-2 para la fuente del tablero, 2-3 para la alimentación por USB. |
CLKIN | J17 | La entrada de reloj para LMK04828. La disposición del defecto proporciona el reloj a CLKIN1 pero se puede configurar para proporcionar un reloj a los pernos de OSCIN. |
XO_PWR | JP2 | Puente corto para proporcionar poder a los 122,88 megaciclos a bordo VCXO para el modo de PLL del LMK04828. Si no usando el VCXO, desconecte el poder de evitar el acoplamiento en el reloj externamente suministrado. |
TXENABLE | JP1 | Controla el perno de TXENABLE del DAC3XJ8X. Cortocircuito 1-2 para permitir la transmisión. |
SUEÑO | JP4 | Controla el perno del SUEÑO del DAC3XJ8X. Cortocircuito 1-2 para poner DAC para dormir. |
FMC_CONNECTOR | J16 | Conexión tablero al desarrollo de TSW14J56 o de FPGA |
USB | J14 | Puerto del cable del USB |
+5V_IN | J23 | enchufe del barril de la fuente de alimentación 5-V |
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